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雙極性晶體管

二極管

ESD保護(hù)、TVS、濾波和信號調(diào)節(jié)ESD保護(hù)

MOSFET

氮化鎵場效應(yīng)晶體管(GaN FET)

絕緣柵雙極晶體管(IGBTs)

模擬和邏輯IC

汽車應(yīng)用認(rèn)證產(chǎn)品(AEC-Q100/Q101)

SOT765-1

74AUP2G00-Q100

參數(shù)類型

型號 VCC (V) Logic switching levels Output drive capability (mA) tpd (ns) fmax (MHz) Nr of bits Power dissipation considerations Tamb (°C) Package name
74AUP2G00DC-Q100 0.8?-?3.6 CMOS ± 1.9 8.3 70 2 ultra low -40~125 VSSOP8

封裝

型號 可訂購的器件編號,(訂購碼(12NC)) 狀態(tài) 標(biāo)示 封裝 外形圖 回流焊/波峰焊 包裝
74AUP2G00DC-Q100 74AUP2G00DC-Q100H
(935690861125)
Active p00 SOT765-1
VSSOP8
(SOT765-1)
SOT765-1 SOT765-1_125

環(huán)境信息

型號 可訂購的器件編號 化學(xué)成分 RoHS RHF指示符
74AUP2G00DC-Q100 74AUP2G00DC-Q100H 74AUP2G00DC-Q100 rohs rhf rhf
品質(zhì)及可靠性免責(zé)聲明

文檔 (10)

文件名稱 標(biāo)題 類型 日期
74AUP2G00_Q100 Low-power dual 2-input NAND gate Data sheet 2024-08-12
AN11052 Pin FMEA for AUP family Application note 2019-01-09
Nexperia_document_guide_MiniLogic_PicoGate_201901 PicoGate leaded logic portfolio guide Brochure 2019-01-07
SOT765-1 3D model for products with SOT765-1 package Design support 2020-01-22
aup2g00 aup2g00 IBIS model IBIS model 2013-04-07
Nexperia_document_leaflet_Logic_AUP_technology_portfolio_201904 Nexperia_document_leaflet_Logic_AUP_technology_portfolio_201904 Leaflet 2019-04-12
Nexperia_package_poster Nexperia package poster Leaflet 2020-05-15
VSSOP8_SOT765-1_mk plastic, very thin shrink small outline package; 8 leads; 0.5 mm pitch; 2 mm x 2.3 mm x 1 mm body Marcom graphics 2017-01-28
SOT765-1 plastic, very thin shrink small outline package; 8 leads; 0.5 mm pitch; 2 mm x 2.3 mm x 1 mm body Package information 2022-06-03
Nexperia_Selection_guide_2023 Nexperia Selection Guide 2023 Selection guide 2023-05-10

支持

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模型

文件名稱 標(biāo)題 類型 日期
SOT765-1 3D model for products with SOT765-1 package Design support 2020-01-22
aup2g00 aup2g00 IBIS model IBIS model 2013-04-07

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